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IF218 – FPGA Conference 2024
Auch dieses Jahr war ich auf der FPGA Conference und möchte in dieser Folge berichten.
Inhalt der Folge:
* Rückblick auf die FPGA Conference 2024
* Besuchte Sessions
* Dienstag
* Fast data transmission with Artix UltraScale+ via various interfaces
* 100GbE from FPGA to Disk
* Open-Source FPGA Tools and Frameworks
* All FPGAs are equal, but some FPGAs are more equal
* Why Should Our Team be Using VHDL+OSVVM for verification?
* FPGA Based 400GBit/s Data Recorder - Insight into different pitfalls and design choices
* Mittwoch
* Verifying a simple DUT (FPGA or module) from scratch with basic verification – for beginners
* Verifying a complex DUT in a simple way from scratch
* What challenges do we encounter while working at the edge of technology
* RTL on a Higher Level: Introducing the Hierarchical FSMD
* Constraining Multiple Clock Domains
* Donnerstag
* MicroBlaze V – the AMD/Xilinx way to do RISC-V
* Using OSVVM’s AXI4 Verification Component
* Perfecting PetaLinux – a hands on tutorial Part 1+2
* Meine Session am Dienstag
* Video Stream Verarbeitung im Zynq 7000
* Ingenieure führen Camp
* Sommerpause
Trage Dich auch gerne in meinen Newsletter ein. Du findest eine Möglichkeit auf der Webseite zu dieser Folge.
Der Beitrag IF218 – FPGA Conference 2024 erschien zuerst auf Ingenieurbüro David C. Kirchner.
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By David KirchnerAuch dieses Jahr war ich auf der FPGA Conference und möchte in dieser Folge berichten.
Inhalt der Folge:
* Rückblick auf die FPGA Conference 2024
* Besuchte Sessions
* Dienstag
* Fast data transmission with Artix UltraScale+ via various interfaces
* 100GbE from FPGA to Disk
* Open-Source FPGA Tools and Frameworks
* All FPGAs are equal, but some FPGAs are more equal
* Why Should Our Team be Using VHDL+OSVVM for verification?
* FPGA Based 400GBit/s Data Recorder - Insight into different pitfalls and design choices
* Mittwoch
* Verifying a simple DUT (FPGA or module) from scratch with basic verification – for beginners
* Verifying a complex DUT in a simple way from scratch
* What challenges do we encounter while working at the edge of technology
* RTL on a Higher Level: Introducing the Hierarchical FSMD
* Constraining Multiple Clock Domains
* Donnerstag
* MicroBlaze V – the AMD/Xilinx way to do RISC-V
* Using OSVVM’s AXI4 Verification Component
* Perfecting PetaLinux – a hands on tutorial Part 1+2
* Meine Session am Dienstag
* Video Stream Verarbeitung im Zynq 7000
* Ingenieure führen Camp
* Sommerpause
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