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Die Episode dieser Woche ist eine ruhigere, aber aufschlussreiche EUV-Woche. Die Schlagzeilen drehen sich weniger um spektakuläre Produktstarts als um die Frage, ob High-NA-EUV, Patterning unterhalb von 2 nm und 2-nm-Kapazitätspläne operativ glaubwürdig werden. Der rote Faden ist einfach: Der Engpass verlagert sich von der Physik hin zu Umsetzung, Kosten und Integration.

Kernaussagen:

- ASML sagt, dass seine High-NA-EUV-Tools nach der Bearbeitung von rund 500.000 Wafern für eine ernsthafte Einführung in die Hochvolumenfertigung bereit sind; aktuell liegt die Verfügbarkeit bei etwa 80 %, zum Jahresende sollen 90 % erreicht werden.

- Intel überdenkt, ob 18A breiter externen Foundry-Kunden angeboten werden soll, was die künftige Auslastung von EUV-Tools und die Kundenqualifikation verändern könnte.

- Rapidus hat 267,6 Milliarden Yen aufgenommen, darunter 100 Milliarden Yen von Japans IPA und 167,6 Milliarden Yen von 32 Unternehmen aus dem Privatsektor, um die 2-nm-Massenproduktion ab 2027 zu unterstützen.

- Chinesische Halbleiter-Manager fordern offen einen national koordinierten Lithografie-Vorstoß für den Zeitraum 2026 bis 2030 und unterstreichen damit, dass Lithografie weiterhin ein systemischer Engpass ist.

- IBMs SPIE-2026-Roadmap argumentiert, dass Fortschritte unterhalb von 2 nm von Edge Placement Error, stochastischer Kontrolle, Resist- und Maskenverhalten sowie Integrationsökonomie abhängen – nicht nur von reiner Auflösung.

- Der wirtschaftliche Nutzen von High-NA steigt nur dann, wenn mehrere Low-NA-Schritte entfallen, ohne dass Verfügbarkeit, Yield oder Integrationsspielraum leiden.

- Advanced Packaging, Reticle Stitching und die Ausrichtung im Backend werden für den EUV-Wertbeitrag wichtiger, weil KI-Chip-Architekturen komplexer werden.

- In einer Woche mit wenig neuen Meldungen ist das klarste Wettbewerbssignal, wer Unsicherheit mit offiziellen Zahlen und fertigungstauglichen Prozessdaten reduziert hat.

Glossar:

Extreme Ultraviolet (EUV)-Lithografie — Ein Verfahren zur Chipstrukturierung mit 13,5-nm-Licht für die kleinsten und kritischsten Merkmale.

High Numerical Aperture (High-NA) EUV — Die nächste EUV-Plattformgeneration mit 0,55 numerischer Apertur für höhere Auflösung und weniger Patterning-Schritte bei fortgeschrittenen Nodes.

Edge Placement Error (EPE) — Die Abweichung zwischen der vorgesehenen Lage einer Strukturkante und dem tatsächlich auf dem Wafer gedruckten Ergebnis.

Stochastische Defekte — Zufällige Strukturierungsfehler, die aus der probabilistischen Natur von Photonen, Resistchemie und sehr kleinen Strukturen entstehen.

k1-Faktor — Ein Lithografie-Skalierungsparameter, der beschreibt, wie stark ein optisches System an seine Auflösungsgrenze herangeführt wird.

Metalloxid-Resist (MOR) — Eine Resistklasse für fortgeschrittenes EUV-Patterning, geschätzt wegen Auflösung, Rauheit und Dünnfilmleistung.

18A — Intels fortgeschrittener Prozessknoten; hier relevant, weil eine breitere Foundry-Nutzung die künftige EUV-Nachfrage und Kapazitätsplanung beeinflussen würde.

Reticle Stitching — Ein Verfahren zum Verbinden benachbarter Belichtungsfelder oder strukturierter Bereiche, oft relevant für Large-Field-Packaging und fortgeschrittene Integrationskonzepte.